Altera CPLD Max II Blink Led


Datenblatt

-Materialien:

-Leds

-Drähte

Für 1 Led ist Verilog-Code:

Modul ledblink(clk,led);
Eingang Clk; Ausgang geführt; Reg geführt;

Reg [23:0] Cnt;

immer Clk) beginnen Cnt < = Cnt + 1' b1; unter der Leitung < = Cnt [23];

Ende

Endmodule

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